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CPUMicroArch:ISSQ两篇高引用论文总结(ISCA'02)InstructionsIssueQueue(ISSQ)在现代乱序执行CPU中起重要作用。.作为乱序调度的起点，ISSQ有以下几个特点：.1.LargeSize:ISSQ的深度直接影响了指令执行并行度(ILP)和乱序窗口，更大的尺寸可以提高CPU性能。.当然，ISSQ的深度...
张殷乾林志强俄亥俄州立大学计算机安全实验室乱序执行(Out-of-OrderExecution)[1]和预测执行(SpeculativeExecution)[2]是现代CPU为了提高性能通常采用的优化方式。乱序就是指CPU不按照程序严格规定的先…
浅谈乱序执行CPU.最早学习乱序执行CPU的时候，是在Wikipedia上自学的，后来在计算机系统结构课上又学了一遍，但发现学的和现在实际采用的乱序执行CPU又有很大区别，后来又仔细研究了一下，觉得理解更多了，就想总结一下。.经典Tomasulo，也是Wikipedia上...
直观地，按代码指定的顺序按CPU执行将是正确的。程序员所具有的错觉是顺序执行。但是，现代CPU并没有遵守这种限制。除非违反相关性(数据相关性，控制相关性和内存相关性)，否则CPU会以乱序的方式执行指令。但是，它对于程序员是完全隐藏的。
阅读论文2019-ndss-《ExSpectre:HidingMalwareinSpeculativeExecution》，了解到一个新概念——SpeculativeExecution。一开始，不太懂这个词的意思，我看翻译有将这个词翻译成“预测执行”，也有翻译成“投机执行”，之后因为是CPU执行相关的...
POWER8处理器微架构论文中对此也有类似的表述：ThePOWER8IFUalsoimplementsmechanismstomitigateperformancedegradationassociatedwithpipelinehazards.AStore-Hit-Load(SHL)isanout-of-orderpipelinehazardcondition,whereanolderstoreexecutesafterayoungeroverlappingload,thussignalingthattheloadreceivedstaledata.
乱序机器并不真正知道或关心它是否正在推测预测但尚未执行的分支的一侧，或推测过去的潜在故障负载。"推测"负载没有故障或者ALU指令不会引发异常，即使在那些并不真正被认为是推测性的CPU中，但是完全无序执行会将其转变为另一种推测。
关于Intel漏洞“熔断”的论文翻译（一）.Thesecurityofcomputersystemsfundamentallyreliesonmemoryisolation,e.g.,kerneladdressrangesaremarkedasnon-accessibleandareprotectedfromuseraccess.Inthispaper,wepresentMeltdown.
CPUMicroArch:ISSQ两篇高引用论文总结(ISCA'02)InstructionsIssueQueue(ISSQ)在现代乱序执行CPU中起重要作用。.作为乱序调度的起点，ISSQ有以下几个特点：.1.LargeSize:ISSQ的深度直接影响了指令执行并行度(ILP)和乱序窗口，更大的尺寸可以提高CPU性能。.当然，ISSQ的深度...
张殷乾林志强俄亥俄州立大学计算机安全实验室乱序执行(Out-of-OrderExecution)[1]和预测执行(SpeculativeExecution)[2]是现代CPU为了提高性能通常采用的优化方式。乱序就是指CPU不按照程序严格规定的先…
浅谈乱序执行CPU.最早学习乱序执行CPU的时候，是在Wikipedia上自学的，后来在计算机系统结构课上又学了一遍，但发现学的和现在实际采用的乱序执行CPU又有很大区别，后来又仔细研究了一下，觉得理解更多了，就想总结一下。.经典Tomasulo，也是Wikipedia上...
直观地，按代码指定的顺序按CPU执行将是正确的。程序员所具有的错觉是顺序执行。但是，现代CPU并没有遵守这种限制。除非违反相关性(数据相关性，控制相关性和内存相关性)，否则CPU会以乱序的方式执行指令。但是，它对于程序员是完全隐藏的。
阅读论文2019-ndss-《ExSpectre:HidingMalwareinSpeculativeExecution》，了解到一个新概念——SpeculativeExecution。一开始，不太懂这个词的意思，我看翻译有将这个词翻译成“预测执行”，也有翻译成“投机执行”，之后因为是CPU执行相关的...
POWER8处理器微架构论文中对此也有类似的表述：ThePOWER8IFUalsoimplementsmechanismstomitigateperformancedegradationassociatedwithpipelinehazards.AStore-Hit-Load(SHL)isanout-of-orderpipelinehazardcondition,whereanolderstoreexecutesafterayoungeroverlappingload,thussignalingthattheloadreceivedstaledata.
乱序机器并不真正知道或关心它是否正在推测预测但尚未执行的分支的一侧，或推测过去的潜在故障负载。"推测"负载没有故障或者ALU指令不会引发异常，即使在那些并不真正被认为是推测性的CPU中，但是完全无序执行会将其转变为另一种推测。
关于Intel漏洞“熔断”的论文翻译（一）.Thesecurityofcomputersystemsfundamentallyreliesonmemoryisolation,e.g.,kerneladdressrangesaremarkedasnon-accessibleandareprotectedfromuseraccess.Inthispaper,wepresentMeltdown.
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