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高速低功耗电压比较器结构设计-微电子学与固体电子学专业论文.优秀毕业论文精品参考文献资料中文摘要摘要：片上系统(SOC)的设计已经由数字型全面转向混合信号型，尤其在无线片中包含数字基带、模拟基带、功耗管理、射频以及锁相环等部分。.混合...
本论文的目的是提供了一种高速低功耗静态比较器，使得比较器能在低功耗的情况下，实现高速比较。1．2国内研究现状比较器是集成电路中不可缺少的重要组成部分，在众多高精度模拟电路中有着广泛的应用，例如可以用于电力按钮、电压检测、电平转换、模数转换器、DC．DC等等。
本论文研究的目的就是设计一种用于差动电路的高速低功耗比较器电路。.1．2比较器的发展历史及研究现状国内目前有五篇关于sub．ADC和比较器设计的学术论文【9】【lo】【II】【12】【13】。.文献【9】设计了一种用于lO．bit100MSPSADC的sub．ADC，其比较器延时...
本论文基于双尾动态比较器进行改进,提出了一种高速、低功耗、低失调的动态比较器。相比于传统的双尾动态比较器,本论文提出的动态比较器能够有效地降低再生阶段的锁存器响应时间,进而减小比较器整体传输时延,同时利用失调消除技术,显著降低了比较器的输入失调电压。
一种高速低功耗迟滞CMOS比较器的分析与设计.【摘要】：文章分析设计了一种具有内部迟滞效应的高速低功耗CMOS比较器,该比较器采用前置放大级、正反馈级和输出驱动级级联的结构,实现了对增益、速度和功耗的优化。.电路的内部迟滞效应有效的实现了对噪声...
一种高速低功耗动态比较器设计.2014年10月MicroelectronicsVol〃44，No〃5Oct〃2014（电子科技大学电子薄膜与集成器件国家重点实验室，成都610054）提出了一种应用于最小能量追踪系统的改进型高速低功耗动态比较器。.通过在锁存比较器中引入额外的正反馈...
高速低功耗SARADC研究意义主要有：高速ADC在通信、测量等领域具有重要作用。.高速ADC是数据采集系统的核心部分，也是影响数据采集系统精度和速度的重要因素。.目前，实时信号处理机要求高速ADC采样率尽可能接近中频甚至射频，从而尽量多的得到目标...
论文基于预放大再生理论，采用SMIC1.2V0.065μmCMOS工艺，设计了一种适用于SARADC的高速低功耗比较器电路，并进行了版图设计。该比较器由前置预放大级、锁存级和输出级构成。前…
一种高速低功耗迟滞CMOS比较器的分析与设计.pdf,第14卷第3期电路与系统学报Vol.14No.32009年6月JOURNALOFCIRCUITSANDSYSTEMSJune，2009文章编号：1007-0249(2009)03-0052-04*一种高速低功耗迟滞CMOS比较器的分析...
逐次近模数转换器高速低功耗子分区法本文关键词：高速低功耗SARADC的设计与实现更多相关文章：逐次近模数转换器高速低功耗子分区法【摘要】：在科学技术快速发展的今天,人们需要处理的信息越来越多。数字信号处理方式相对于模拟信号处理方式,有着更高的可靠性以及需要更低的...
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