摘 要:介绍用multisim仿真软件分析移位寄存器逻辑功能的方法,验证了4-d触发器构成的移位寄存器的逻辑功能。用multisim仿真软件中的字组产生器产生的信号作为移位寄存器的时钟脉冲和输入数据,字组内容反映移位寄存器的输入信号和控制信号,用multisim中的逻辑分析仪多踪同步显示各输入信号、控制信号和输出信号波形,直观地描述移位寄存器的工作过程。所述方法创新地解决了移位寄存器工作过程无法用实验仪器验证的问题。关键词:移位寄存器; multisim仿真; 字组产生器; 逻辑分析仪
multisim simulation of shift register
li chun-ran1, yang ya-juan2
(1.department of physics, bohai university, jinzhou 121000, china; 2.northwest civil aviation air traffic management bureau, xi’an 710082, china)
abstract: the method of using multisim simulation software to analyze the working process of the shift register is introduced. the logic function of a shift register composed of 4-d flip-flop is verified. the signal yielded by character set generator in multisim simulation software is taken as the clock pulse and input data of the shift register. the contect of the character set reflects the input and control signals of the shift register.the logic analyzer in multisim is employed to synchronously display the waveforms of each input signal, control signal and output signal, and to make the working process of shift register be described visually. the innovation of this method is that the problem that the working waves of shift register can not be analyzed and verified with electronic instruments is solved.keywords: shift register; multisim simulation; generator of character set; logic analyzer
0 引 言
寄存器是计算机和其他数字系统中用来储存代码或数据的逻辑部件[1-3],它的主要组成部分是触发器。wWW.133229.coM有时为了处理数据,需要将寄存器中的各位数据在移位控制信号作用下,依次向高位或低位移动1位,具有移位功能的寄存器称为移位寄存器[2]。
常规的硬件实验测试移位寄存器逻辑功能的方法是,将移位寄存器的控制端和数据输入端分别接逻辑电平开关,改变逻辑电平开关为逻辑1、逻辑0,观测输出信号的逻辑状态。存在的问题是,测得各输入/输出信号关系不直观。
用multisim仿真软件[4-10]进行移位寄存器工作过程波形仿真分析,用虚拟仪器中的字组产生器[4-6]做实验中的信号源,产生所需的各个输入数据和控制信号,用逻辑分析仪[4-6]显示输入数据、控制信号和输出信号波形,可直观描述移位寄存器的工作过程及逻辑功能。
1 移位寄存器工作过程multisim仿真实验方法
1.1 创建电路
从multisim的ttl数字ic库中找出所需触发器,将这些触发器串接起来,构成一个移位寄存器。从虚拟仪器库中找出字组产生器、逻辑分析仪[4-6]。
确定字组产生器产生移位寄存器所需的各个控制信号、输入数据信号,确定逻辑分析仪所显示的输入控制信号、输入数据信号及输出函数信号,将第一位触发器的输入端和各触发器的控制端接字组产生器,各个触发器的输入端和输出端接逻辑分析仪。
1.2 设置字组产生器
确定反映移位寄存器控制端、数据输入端不同输入情况的字组产生器各个字组的内容及地址;在字组产生器中设置字组始、末地址,依次输入各字组数据,进行字组信号的设置[4-6]。
1.3 仿真运行分析
进行实验仿真,分析仿真实验结果。
2 移位寄存器工作过程multisim仿真实验举例
由4个边沿d触发器依次串接可构成1个4位移位寄存器如图1所示。数据从串行输入端di输入,左边触发器的输出作为右邻触发器的数据输入[1-2]。
设移位寄存器的初始状态为0000,现将数码d3d2d1d0(1101)从高位(d3)至低位依次送到di端,经过第一个时钟脉冲后,q0=d3。由于跟随数码d3后面的数码是d2,经过第二个时钟后,触发器u1a的状态移入触发器u1b,而u1a变为新的状态,即q1=d3,q0=d2。依此类推,可得4位右向移位寄存器的状态,如表1所示。由表1可知,输入数码依次由低位触发器到高位触发器做右向移动。经过4个时钟脉冲后,4个触发器的输出状态q3q2q1q0与输入数码d3d2d1d0相对应。
表1图1电路状态表
cpq0q1q2q3
1d3000
2d2d300
3d1d2d30
4d0d1d2d3
2.1 仿真实验电路创建
构建仿真实验电路如图1所示。
图1 用边沿d触发器构成的4位移位寄存器仿真实验电路
字组产生器产生第1位触发器(u1a)的输入数据和4个触发器的控制脉冲,逻辑分析仪显示控制信号,数据输入信号及q0～q3输出信号的波形。各触发器的清零端和预置端均接高电平。
2.2 字组产生器输出字组的设计
字组内容反映移位寄存器不同输入端的输入情况,输入波形设计、字组内容及地址如图2所示。
图2 移位寄存器波形设计及字组数据
将各字组数据转换成相应的10进制代码,并在字组产生器的在数据区块以10进制(dec字段)依次输入各字组数据2,3,2,3,0,1,2,3,0,1,0,1,0,1,0,1 ,各数据反映输入di端输入数据和时钟脉冲,将第一个数据“2”和最后一个数据“1”分别设为字组数据的始、末地址,完成所有字组信号的设置。如图3所示。
图3 移位寄存器仿真实验字组设置
2.3 仿真运行分析
逻辑分析仪显示的波形如图4所示。
图4中,“1”为时钟脉冲的波形,“2”为输入di端信号的波形,“3” 为 q0输出信号的波形,“4” 为 q1输出信号的波形、“5” 为q2输出信号的波形、“6” 为 q3输出信号即do的波形。由图4可知:4个d触发器依次输出输入数据,高位触发器与低位触发器的输出波形只相差一个脉冲周期。
图4 移位寄存器仿真实验波形经过4个时钟脉冲后,4个触发器储存了di端的输入信号,即串行输入数据可经4个d触发器并行输出。经过8个时钟脉冲后,输入信号从q3端已全部移出寄存器,即存入该寄存器的数据也可以从do端串行输出。
3 结 语
由于受实验仪器的限制无法对移位寄存器工作波形进行硬件实验验证,主要问题是,现有的信号发生器不能产生多路同步信号,现有的示波器多为双踪示波器无法同时观测多路波形,用multisim软件仿真解决了这一问题。所述方法具有实际应用意义[9-10]。
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